Log

【免费下载链接】asc-devkit本项目是CANN 推出的昇腾AI处理器专用的算子程序开发语言，原生支持C和C++标准规范，主要由类库和语言扩展层构成，提供多层级API，满足多维场景算子开发诉求。项目地址: https://gitcode.com/cann/asc-devkit

产品支持情况

• Ascend 950PR/Ascend 950DT：支持

• Atlas A3 训练系列产品/Atlas A3 推理系列产品：不支持

• Atlas A2 训练系列产品/Atlas A2 推理系列产品：不支持

• Atlas 200I/500 A2 推理产品：不支持

• Atlas 推理系列产品AI Core：不支持

• Atlas 推理系列产品Vector Core：不支持

• Atlas 训练系列产品：不支持

功能说明

头文件路径："basic_api/reg_compute/kernel_reg_compute_vec_unary_intf.h"。

该接口根据mask逐元素对源操作数求自然对数，将结果写入目的操作数。计算公式如下：

$$dstReg_i = \log(srcReg_i)$$

函数原型

template <typename T = DefaultType, auto mode = MaskMergeMode::ZEROING, typename U> __simd_callee__ inline void Log(U& dstReg, U& srcReg, MaskReg& mask)

参数说明

表 1模板参数说明

enum class LogAlgo {
INTRINSIC = 0,
PRECISION_1ULP_FTZ_TRUE,
PRECISION_1ULP_FTZ_FALSE,
};
struct LogSpecificMode {
MaskMergeMode mrgMode = MaskMergeMode::ZEROING,
LogAlgo algo = LogAlgo::INTRINSIC;
};

表2参数说明

数据类型

目的操作数与源操作数的数据类型需要保持一致。支持的数据类型为：half、float。

返回值说明

无

约束说明

无

关键特性说明

最大精度误差

• LogAlgo::INTRINSIC、LogAlgo::PRECISION_1ULP_FTZ_TRUE，最大精度误差为1ulp。
• LogAlgo::PRECISION_1ULP_FTZ_FALSE，最大精度误差为1ulp。

配置Subnormal模式：
FTZ（Flush To Zero）：一种浮点运算模式，当结果为Subnormal时，将其直接清零（近似为0），而非保留其精确的微小数值。
只有将algo设置为LogAlgo::PRECISION_1ULP_FTZ_FALSE时，Log接口才会保留并正确输出Subnormal结果；其他模式下Subnormal均被FTZ。
一般场景推荐使用性能更好的LogAlgo::INTRINSIC、LogAlgo::PRECISION_1ULP_FTZ_TRUE；需要精确Subnormal输出的场景（如特定数据精度要求的算法、避免除零错误）使用LogAlgo::PRECISION_1ULP_FTZ_FALSE。

调用示例

template<typename T> __simd_vf__ inline void LogVF(__ubuf__ T* dstAddr, __ubuf__ T* srcAddr, uint32_t count, uint16_t oneRepeatSize, uint16_t repeatTimes) { AscendC::Reg::RegTensor<T> srcReg; AscendC::Reg::RegTensor<T> dstReg; AscendC::Reg::MaskReg mask; // Subnormal模式 // static constexpr AscendC::Reg::LogSpecificMode mode = {MaskMergeMode::ZEROING, LogAlgo::PRECISION_1ULP_FTZ_FALSE}; for (uint16_t i = 0; i < repeatTimes; i++) { mask = AscendC::Reg::UpdateMask<T>(count); AscendC::Reg::LoadAlign(srcReg, srcAddr + i * oneRepeatSize); AscendC::Reg::Log(dstReg, srcReg, mask); // Subnormal模式 // AscendC::Reg::Log<DTYPE, &mode>(dstReg, srcReg, mask); AscendC::Reg::StoreAlign(dstAddr + i * oneRepeatSize, dstReg, mask); } }

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